Verilog HDL數(shù)字控制系統(tǒng)設計實例

定　價：￥28.00

作　者：	冼進等
出版社：	中國水利水電出版社
叢編項：	萬水電子技術叢書
標　簽：	教材

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ISBN：	9787508444697	出版時間：	2007-04-01	包裝：	平裝
開本：	787*1092	頁數(shù)：	250	字數(shù)：

內(nèi)容簡介

　　作為可編程邏輯器件的開發(fā)語言Verilog HDL，由于其具有類似于通用C語言的風格，被不少CPLD/FPGA開發(fā)者所推崇。在數(shù)字控制領域，CPLD/FPGA的應用也越來越廣，因此，作為開發(fā)語言Verilog HDL就顯示了它的重要性。有關Verilog HDL的書籍很少，為了滿足廣大讀者學習Verilog HDL的需要，作者在總結多年教學與開發(fā)經(jīng)驗的基礎上編寫了本書，內(nèi)容安排如下：首先簡單介紹Verilog HDL的語法，基本組合邏輯電路的Verilog HDL設計與實現(xiàn)，以及基本時序邏輯電路的Verilog HDL設計與實現(xiàn)；然后，通過多個綜合性數(shù)字控制系統(tǒng)Verilog HDL設計與實現(xiàn)的例子，重點地講解了較為復雜的數(shù)字控制系統(tǒng)的Verilog HDL設計與實現(xiàn)，包括數(shù)字頻率計、交通燈控制系統(tǒng)、多功能數(shù)字鐘、步進電機位置系統(tǒng)、直流電動機控制系統(tǒng)、實用電梯控制器以及CCD芯片TCD132D的驅動控制等?！”緯鴥?nèi)容翔實、語言通俗易懂，實例實用性和針對性強，既可作為通信工程、電子工程、計算機、自動控制等專業(yè)的學習數(shù)字電路設計的大學本科高年級學生和研究生Verilog HDL開發(fā)的學習用書，也適合作為數(shù)字系統(tǒng)設計工程師和Verilog開發(fā)者的參考用書。本書案例源代碼可以從中國水利水電出版社網(wǎng)站免費下載，網(wǎng)址為：http：//www.waterpub.com.cn/softdown/。

作者簡介

暫缺《Verilog HDL數(shù)字控制系統(tǒng)設計實例》作者簡介

圖書目錄

前言
第1章 Verilog HDL的基礎知識
1.1 概述
1.1.1 Verilog HDL的發(fā)展歷史
1.1.2 Verilog HDL的主要功能
1.1.3 Verilog HDL與VHDL的比較
1.2 Verilog HDL的基本語言要素
1.2.1 標識符
1.2.2 程序注釋
1.2.3 書寫格式
1.2.4 系統(tǒng)任務和系統(tǒng)函數(shù)
1.2.5 編譯器偽指令
1.3 Verilog HDL的數(shù)據(jù)類型
1.3.1 線網(wǎng)類型
1.3.2 未說明的線網(wǎng)
1.3.3 向量和標量線網(wǎng)
1.3.4 寄存器類型
1.4 Verilog HDL的表達式
1.4.1 操作數(shù)
1.4.2 操作符
1.5 Verilog HDL的基本結構
1.5.1 模塊
1.5.2 寸延
1.5.3 數(shù)據(jù)流描述方式
1.5.4 行為描述方式
1.5.5 結構化描述方式
1.5.6 混合設計描述方式
第2章基本邏輯電路設計實例
2.1 基本組合邏輯電路設計
2.1.1 基本門電路
2.1.2 譯碼器
2.1.3 編碼器
2.1.4 三態(tài)緩沖器
2.1.5 多路復用器
2.1.6 比較器
2.1.7 加法器與減法器
2.1.8 乘法器
2.2 基本時序邏輯電路設計
2.2.1 觸發(fā)器
2.2.2 分頻器
2.2.3 移位寄存器
2.2.4 序列信號發(fā)生器
2.3 存儲器設計
2.3.1 ROM
2.3.2 SRAM
2.3.3 FIFO
第3章基于Verilog HDL的數(shù)字控制系統(tǒng)設計
3.1 需求分析
3.2 總體設計
3.2.1 系統(tǒng)任務分析
3.2.2 設計方案描述
3.2.3 總體框圖設計
3.3 器件選擇
3.3.1 可編程邏輯器件的選擇
3.3.2 外圍器件的選擇
3.4 邏輯算法及程序實現(xiàn)
3.4.1 邏輯算法設計
3.4.2 硬件描述語言程序設計
3.4.3 功能仿真
3.4.4 時序仿真
3.5 邏輯的物理實現(xiàn)
3.6 系統(tǒng)整體調試
第4章數(shù)字頻率計
4.1 數(shù)字頻率計功能描述
4.2 數(shù)字頻率計系統(tǒng)框圖
4.3 數(shù)字頻率計的Verilog HDL程序設計
4.3.1 計數(shù)模塊counter
4.3.2 門控模塊gate_control
4.3.3 分頻模塊fdiv
4.3.4 寄存器模塊nip latch
4.3.5 多路選擇模塊data mux
4.3.6 動態(tài)位選模塊dispselect
4.3.7 BCD譯碼模塊dispdecodei
4.3.8 頂層電路Top
4.4 小結
第5章交通燈控制系統(tǒng)
5.1 交通燈控制系統(tǒng)功能描述及系統(tǒng)框圖
5.1.1 系統(tǒng)功能描述
5.1.2 交通燈控制系統(tǒng)框圖
5.2 交通燈控制系統(tǒng)的Verilog HDL程序設計
5.2.1 主控制模塊control
5.2.2 55秒倒計時模塊counter55
5.2.3 5秒倒計時模塊counter05.
5.2.4 倒計時時間選擇驅動模塊scan
5.2.5 倒計時時間選擇模塊counte elect
5.2.6 1kHz時鐘信號模塊fdivlkHz
5.2.7 lHz計數(shù)時鐘信號模塊fdivlhz
5.2.8 倒計時時間數(shù)據(jù)多路選擇模塊datamux
5.2.9 動態(tài)顯示驅動模塊dispselect
5.2.10 顯示數(shù)據(jù)多路選擇模塊dispmux
5.2.11 顯示數(shù)據(jù)譯碼模塊dispdecodet'
5.2.12 頂層電路Top
5.3 小結
第6章多功能數(shù)字鐘
6.1 多功能數(shù)字鐘功能描述及系統(tǒng)框圖
6.1.1 多功能數(shù)字鐘功能描述
6.1.2 多功能數(shù)字鐘系統(tǒng)框圖
6.2 多功能數(shù)字鐘的Verilog HDL程序設計
6.2.1 主控制模塊：maincontt'ol
6.2.2 時間及其設置模塊time auto and set
6.2.3 時間顯示動態(tài)位選模塊time-disp-select
6.2.4. 顯示模塊disp data mLIx
6.2.5 秒表模塊stopwatch
6.2.6 日期顯示與設置模塊date
6.2.7 鬧鐘模塊alatTnclock
6.2.8 分頻模塊fdiv
6.2.9 頂層電路Top
6.3 小結
第7章步進電機位置系統(tǒng)
7.1 步進電機位置系統(tǒng)功能描述及系統(tǒng)框圖
7.1.1 步進電機位置系統(tǒng)功能描述
7.1.2 步進電機位置系統(tǒng)框圖
7.2 步進電機位置系統(tǒng)的Verilog HDL程序設計
7.2.1 分頻模塊fdiv
7.2.2 16位計數(shù)器模塊counter 16 bits
7.2.3 16種脈沖產(chǎn)生模塊pulse 16
7.2.4. 每秒輸出脈沖數(shù)寄存器模塊second pulse latch
7.2.5 脈沖疊加模塊pulse sum
7.2.6 總脈沖輸出控制模塊sum COlatrol
7.2.7 頂層電路TOD
7.3 小結
第8章直流電動機控制系統(tǒng)
8.1 直流電動機控制系統(tǒng)功能描述
8.2 直流電動機控制系統(tǒng)框圖
8.3 直流電動機控制系統(tǒng)的Vet5log HDL程序設計
8.3.1 電流采樣控制模塊CurTent adc ctrl
8.3.2 電流調節(jié)模塊Current Adiust
8.3.3 速度檢測模塊Rate Measure
8.3.4 速度調節(jié)模塊Rate Adiust
8.3.5 位置采樣控制模塊Position adc ctrl
8.3.6 位置調節(jié)模塊Position Adjust
8.3.7 主控制模塊Main Ctrl
8.3.8 頂層電路Top
8.4 小結
第9章實用電梯控制器
9.1 實用電梯控制器功能描述
9.2 實用電梯控制器系統(tǒng)框圖
9.2.1 主控制器
9.2.2 從控制器
9.3 實用電梯控制器的Verilog HDL程序設計
9.3.1 主控制器Master Control
9.3.2 從控制器Slave Control
9.4 小結
第10章 CCD芯片TCDl32D的驅動控制
10.1 CCD技術簡介及CCD器件的選用
10.1.1 CCD技術及其應用
10.1.2 CCD器件的選用
10.2 典型CCD集成芯片TCDl32D簡介
10.3 CCD芯片TCDl32D的驅動控制設計
10.3.1 各種脈沖信號的產(chǎn)生方式
10.3.2 CCD芯片TCDl32D的驅動控制的Verilog.HDL程序
10.4 CCD芯片TCDl32D的輸出信號的噪聲處理
10.4.1 噪聲及其統(tǒng)計特性
10.4.2 噪聲通過電路的響應
10.4.3 濾波器的作用
10.5 小結
參考文獻